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1993
Journal Article
Titel
Simulator für die Systemebene
Abstract
Die Verifikation fon signalverarbeitenden Architekturkonzepten spielt gerade in den frühen Phasen des Entwurfs, das heißt auf der Systemebene, eine entscheidende Rolle. Realisierungsprobleme, die bereits hier abgefangen werden, bringen eine deutliche Kosteneinsparung. Der im folgenden Beitrag dargestellte schnelle symbolische Simulator kann hier wertvolle Hilfe leisten, zumal er in verschiedene interaktive ergonomische Werkzeuge eingebettet ist.
Language
German