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Erstellung und Verifizierung eines VHDL-AMS-Modells für einen kapazitiven Delta-Sigma-Modulator

 
: Slawinski, S.; Zacharias, L.; Dorn, R.; Hauer, J.

Gremzow, C. ; Informationstechnische Gesellschaft -ITG-; VDE/VDI-Gesellschaft Mikroelektronik, Mikro- und Feinwerktechnik -GMM-:
12. Workshop Methoden und Beschreibungssprachen zur Modellierung und Verifikation von Schaltungen und Systemen 2009 : 2. - 4.3.2009, TU Berlin
Berlin: Technische Universität Berlin, 2009
ISBN: 978-3-7983-2118-2
S.227-236
Workshop Methoden und Beschreibungssprachen zur Modellierung und Verifikation von Schaltungen und Systemen <12, 2009, Berlin>
Deutsch
Konferenzbeitrag
Fraunhofer IIS ()

Abstract
In dieser Arbeit wurde untersucht, welche Möglichkeiten die Hardwarebeschreibungssprache VHDL-AMS1 zur Optimierung des Entwicklungsablaufes eines kapazitiven Delta-Sigma-Umsetzers in SC-Technik2 bietet. Dazu wurden VHDL-AMSModelle der Einzelkomponenten erstellt und Simulationszeiten und ergebnisse mit SPICE/SPECTRE- Transistormodellen verglichen. Aus den entwickelten Einzelmodellen wurde ein differentieller Delta-Sigma-Modulator 1. Ordnung aufgebaut. Es erfolgt ein Vergleich der Simulationsergebnisse und zeiten mit verschiedenen Modellen, aus denen Aussagen über die Einsatzmöglichkeiten abgeleitet werden.

: http://publica.fraunhofer.de/dokumente/N-101437.html