Fraunhofer-Gesellschaft

Publica

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Selbstkalibrierende Sigma-Delta-Umsetzer mit Multibit-Rückführung

 
: Hauer, H.; Mödl, S.

Pirsch, P. ; Institute of Electrical and Electronics Engineers -IEEE-; Univ. Hannover; Informationstechnische Gesellschaft -ITG-; VDE/VDI-Gesellschaft Mikroelektronik, Mikro- und Feinwerktechnik -GMM-:
Mikroelektronik für die Informationstechnik. Vorträge der ITG-Fachtagung am 3. und 4. März 1998 in Hannover
Berlin: VDE-Verlag, 1998 (ITG-Fachbericht 147)
ISBN: 3-8007-2325-5
pp.55-60
Fachtagung Mikroelektronik für die Informationstechnik <8, 1998, Hannover>
German
Conference Paper
Fraunhofer IIS A ( IIS) ()
CMOS-Integration; Sigma-Delta-ADC; Sigma-Delta-ADU; Sigma-Delta-Analog-Digital-Umsetzer; Sigma Delta Analog to Digital Converter; system comparison; Systemvergleich

Abstract
Ein 5 Bit 150 MS/s, CMOS Parallel ADI mit einer Verlustleistung von nur 85 mW (88 MS/s) mit einstellbarer Referenz wird vorgestellt. Durch Maßnahmen zur Verlustleistungsminimierung wird dieser niedrige Wert möglich. Der ADU erreicht eine ENOB von mehr als 4 bit bei 44 MHz Eingangssignal. Messungen bestätigen hervorragende statische und dynamische Eigenschaften mit sehr niedriger Verlustleistung und einer geringen Fläche von nur 0,9 mm2.

: http://publica.fraunhofer.de/documents/PX-33042.html