Fraunhofer-Gesellschaft

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Retargierbarer Entwurfsablauf für dynamisch rekonfigurierbare Hardware

 
: Meißner, T.
: Feske, K.; Boden, M.

Dresden: HTW, 2006, XI, 103 pp.
Dresden, Hochschule für Technik und Wirtschaft, Dipl.-Arb., 2006
German
Thesis
Fraunhofer IIS, Institutsteil Entwurfsautomatisierung (EAS) ()

Abstract
Ein retargierbarer Entwurfsablauf für dynamisch rekonfigurierbare Hardware wird durch die Einführung eines Bibliothekskonzeptes erreicht, in dem architekturspezifische und -unabhängige Elemente voneinander gekapselt und kombiniert zur Verfügung gestellt werden. Die Bibliothek wurde um ein Modul zur effektiven Kommunikation zwischen rekonfigurierbaren HW-Tasks erweitert. Es wurde ein Generatorwerkzeug entwickelt, welches die für den Entwurfsablauf notwendige Designumgebung (Top-Level Design) und die Einstellungen zur Plazierung und Verdrahtung (UCF, User Constraint File) mittels architekturspezifischer, anpassbarer Templates erzeugt. Die entwickelte Entwurfsmethodik wurde anhand einer Beispielapplikation unter Anwendung der HLS, einem Reed-Solomon Coder, evaluiert.

: http://publica.fraunhofer.de/documents/N-50991.html